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FrameScan電容藕合測試
FrameScan利用電容藕合探測管腳的脫開。每個器件上面有一個電容性探頭，在某個管腳激勵信號，電容性探頭拾取信號。如圖所示：
1 夾具上的多路開關板選擇某個器件上的電容性探頭。
2 測試儀內的模擬測試板（ATB）依次向每個被測管腳發(fā)出交流信號。
3 電容性探頭采集并緩沖被測管腳上的交流信號。
4 ATB測量電容性探頭拾取的交流信號。如果某個管腳與電路板的連接是正確的，就會測到信號；如果該管腳脫開，則不會有信號。
GenRad類式的技術稱Open Xpress。原理類似。
此技術夾具需要傳感器和其他硬件，測試成本稍高。
邊界掃描技術
Boundary-Scan邊界掃描技術
ICT測試儀要求每一個電路節(jié)點至少有一個測試點。但隨著器件集成度增高，功能越來越強，封裝越來越小，SMT元件的增多，多層板的使用，PCB板元件密度的，要在每一個節(jié)點放一根探針變得很困難，為增加測試點，使制造費用增高；同時為開發(fā)一個功能強大器件的測試庫變得困難，開發(fā)周期延長。為此，聯(lián)合測試組織（JTAG）頒布了IEEE1149.1測試標準。

IEEE1149.1定義了一個掃描器件的幾個重要特性。先定義了組成測試訪問端口（TAP）的四（五〕個管腳：TDI、TDO、TCK、TMS，（TRST）。測試方式選擇（TMS）用來加載控制信息；其次定義了由TAP控制器支持的幾種不同測試模式，主要有外測試（EXTEST）、內測試（INTEST）、運行測試（RUNTEST）；提出了邊界掃描語言（Boundary Scan Description Language），BSDL語言描述掃描器件的重要信息，它定義管腳為輸入、輸出和雙向類型，定義了TAP的模式和指令集。
具有邊界掃描的器件的每個引腳都和一個串行移位寄存器（SSR）的單元相接，稱為掃描單元，掃描單元連在一起構成一個移位寄存器鏈，用來控制和檢測器件引腳。其特定的四個管腳用來完成測試任務。
將多個掃描器件的掃描鏈通過他們的TAP連在一起就形成一個連續(xù)的邊界寄存器鏈，在鏈頭加TAP信號就可控制和檢測所有與鏈相連器件的管腳。這樣的虛擬接觸代替了針床夾具對器件每個管腳的物理接觸，虛擬訪問代替實際物理訪問，去掉大量的占用PCB板空間的測試焊盤，減少了PCB和夾具的制造費用。
作為一種測試策略，在對PCB板進行可測性設計時，可利用軟件分析電路網點和具掃描功能的器件，決定怎樣有效地放有限數(shù)量的測試點，而又不減低測試覆蓋率，經濟的減少測試點和測試針。

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ict，即自動在線測試儀，是現(xiàn)代電子企業(yè)*的PCBA(Printed- Circuit Board Assembly，印刷電路板組件）生產的測試設備，ICT使用范圍廣，測量準確性高，對檢測出的問題指示明確，即使電子技術水準一般的工人處理有問題的PCBA也非常容易。
中文名 自動在線測試儀 簡    稱 ict 全    稱 In—Circuit—Tester 特    點 測量準確性高

基本優(yōu)化
每塊PCB可以采用光學或者X-ray技術并運用適當 的運算法則來進行檢查?；趫D像檢查的基本 原理是：每個具有明顯對比度的圖像都是可以 被檢查的。在AOI中存在的主要問題是，當一些檢查對象是 不可見的，或是在PCB上存在一些干擾使得圖像變得模糊 或隱藏起來了。然而，實際經驗和系統(tǒng)化測試都表明，這 些影響是可以通過PCB的設計來預防甚至減少的。為了推 動這種優(yōu)化設計，可以運用一些看上去很古老的附加手段（這些方法仍在很多領域被推崇），它的優(yōu)點包括：
減少編程時間
限度地減少誤報 改善失效檢查。
制定設計方針，可以有效地簡化檢查和顯著地降低生 產成本。Viscom AG 和 KIRRON GmbH &Co KG 合作開發(fā) 出一項測試方案，目的是為了從根本上研究和這 些設計在檢查中產生的效果?；贗PC-7350標準的PCB布 局被推薦為針對這些測試的基準。先，為了探究每一種 布局的檢查效果，建議在大量PCB布局上采用這種基準； 之后，再有意地利用PCB錯誤布局，使得它產生一些工藝 中的缺陷，如立碑和引腳懸空等。
布局建議
針對AOI檢查的PCB整體布局
器件到PCB的邊緣應該至少留有3mm（0.12”）的工 藝邊。片式器件必須優(yōu)先于圓柱形器件。布局上建議考慮 傳感器技術，因為有時檢查只能通過垂直（正交）角度，而其他時候又需要一個的角度來進行。
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